Frage im Vorstellungsgespräch bei IEC Electronics: Design a basic AND gate using transistor level logic. | Glassdoor

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IEC Electronics

Electrical Engineering Intern – Vorstellungsgespräche bei IEC Electronics

Frage im Vorstellungsgespräch bei IEC Electronics

Vorstellungsgespräch für eine Beschäftigung als Electrical Engineering Intern

Design a basic AND gate using transistor level logic.

Antwort im Vorstellungsgespräch

Anonym

4. Nov. 2012

Paralleled NMOS followed by series PMOS

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Vorstellungsgespräche bei IEC Electronics